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NTU Theses and Dissertations Repository
瀏覽 的方式: 作者 顧孟愷(Mong-Kai Ku)
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2011
低密度同位檢查碼系統設計
Design of Low-Density Parity-Check Coding Systems
Chia-Yu Lin; 林家瑜
資訊工程學研究所
2006
低密度奇偶校驗碼之解碼器的軟硬體分割方式探索
A Hardware/Software Exploration of LDPC Decoder Design
Yi-der Lin; 林宜德
資訊工程學研究所
2008
使用降低解碼運算數目演算法之低功率IEEE 802.16e LDPC 硬體解碼器之設計與實現
Design and Implementation of a Low-Power IEEE 802.16e LDPC Decoder by Utilizing Decoding Operation Reduction Algorithm
Shu-Cheng Chou; 周書正
資訊工程學研究所
2005
可自動化產生的匯流排包裝器方法論
A Methodology for Generating Bus Wrapper Automatically
Yi-Chun Chung; 鍾宜君
資訊工程學研究所
2005
可變動高速奇偶校驗編碼之解碼器結構設計
Scalable High HUE LDPC Decoder Architecture Design
Yi-hsing Chien; 簡義興
資訊工程學研究所
2013
可配置低密度奇偶檢查碼解碼器設計與實作
Design and Implementation of Configurable Low-Density Parity-Check Codes Decoder
Yi-Hsing Chien; 簡義興
資訊工程學研究所
2010
可重載的超長低密度奇偶校正碼解碼器
A configurable very long codeword length LDPC decoder
Hsiu-Hung Lin; 林修鴻
資訊工程學研究所
2007
多重編碼率低密度奇偶校正碼之解碼器 適用於IEEE 802.16e
Multi-Rate LDPC Decoder for IEEE 802.16e
Yu-Min Chang; 張育民
資訊工程學研究所
2011
多重編碼率階層式低密度奇偶校正碼解碼器之疊代控制演算法
An Iteration Control Algorithm for Multi-Rate Layered LDPC Decoder
Jian-Bang Liu; 劉建邦
資訊工程學研究所
2005
專為無線通訊應用之低密度奇偶校驗編碼正交分頻多工調變系統設計
Low-Density Parity-Check Coded Orthogonal Frequency Division Multiplexing Modulation System Design for Wireless Communication Applications
Chih-Yuan Yang; 楊智淵
資訊工程學研究所
2007
快速高斯雜訊產生器之設計與實作
Design and Implementation of a Fast Gaussian Noise Generator
Jen-Chieh Wang; 王仁傑
資訊工程學研究所
2009
提高信賴值之LDPC 解碼節點處理器
A Belief Enhancement Node Processor for LDPC Decoding
Chi-Wei Chen; 陳其蔚
資訊工程學研究所
2010
改進且提高信賴值之LDPC解碼節點處理器
Improved LDPC Decoding with Belief Enhancement Node Processor
Cheng-Kang Li; 李政鋼
資訊工程學研究所
2006
硬體矽智財在系統晶片上的介面設計方法及合成
Hardware IP interface design and synthesis for System-on-a-Chip
Ching-Hsin Lee; 李清新
資訊工程學研究所
2007
系統晶片上網路晶片系統的產生及合成
networks on chip generation and synthesis for system-on-a-chip
Der-Tzeng Tsai; 蔡德政
資訊工程學研究所
2007
系統晶片的軟硬體介面合成
HW/SW Interface Synthesis for SoC Design
Kun-Lin Wu; 吳坤霖
電機工程學研究所
2007
階層式類迴旋低密度奇偶校驗碼之半平行分層解碼器架構設計
Semi-Parallel Layered Decoder Architecture Design for Hierarchical QC LDPC Codes
Kuo-Hsing Juan; 阮國興
資訊網路與多媒體研究所
2009
高效率IEEE802.16e編碼器設計與實作
An Efficient FPGA Implementation of IEEE 802.16e LDPC Encoder
Chao-Yuan Yu; 游超元
資訊工程學研究所