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2008
使用降低解碼運算數目演算法之低功率IEEE 802.16e LDPC 硬體解碼器之設計與實現
Design and Implementation of a Low-Power IEEE 802.16e LDPC Decoder by Utilizing Decoding Operation Reduction Algorithm
Shu-Cheng Chou; 周書正
資訊工程學研究所
探索
系所
1
資訊工程學研究所
學位
1
碩士
指導教授
1
顧孟愷(mong-kai ku)
作者
1
shu-cheng chou
關鍵字
1
ldpc,low-power
1
ldpc,low-power,decoder
1
低密度奇偶校驗碼
1
低密度奇偶校驗碼,低功率
1
低密度奇偶校驗碼,低功率,解碼器
出版年
1
2008
全文授權
1
有償授權
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1
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