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2011
使用抑制時脈抖動技術鎖相回路之設計與實作
Design and Implementation of A Low Noise Phase-Locked Loop with Jitter Suppression Technique
Bang-Zao Liou; 劉邦灶
電子工程學研究所
2006
適用於40~48GHz超寬頻系統之18.5GHz全差動式鎖相迴路
A 18.5GHz Fully Differential Phase Lock Loop for 40~48GHz UWB System
Tz-Cheng Yang; 楊子承
電子工程學研究所
2006
適用於鎖相頻率合成器之突波雜訊抑制技術研究
A Spur Suppression Technique for Phase-Locked Frequency Synthesizers
Wei-Liang Lee; 李韋良
電子工程學研究所
2011
可適性接收機與次諧波注入鎖相迴路分析與設計
Analysis and Design of Adaptive Receiver and Subharmonically Injection-Locked PLL
Yi-Chieh Huang; 黃逸傑
電子工程學研究所
2007
二元相位頻率偵測器之設計與應用
Design and Implementation of Bang-Bang Phase/Frequency Detectors
Shao-Hung Lin; 林紹弘
電子工程學研究所
2007
適用於315/433/868/915 MHz ISM頻帶之分數型頻率合成器
A Fractional-N Frequency Synthesizer for 315/433/868/915 MHz ISM Bands
Fang-Ting Lee; 李昉亭
電子工程學研究所
2010
CMOS鎖相迴路頻率合成器之研究與應用
The Design and Application of CMOS PLL-Based Frequency Synthesizers
Yuen-Tai Chang; 張元泰
電子工程學研究所
2008
適用於寬頻無線通訊系統之CMOS鎖相迴路頻率合成器
CMOS PLL-Based Frequency Synthesizers for Broadband Wireless Communication System
Sheng-Hung Lin; 林聖紘
電子工程學研究所
2005
應用小數頻率合成器於GMSK調變
A GMSK Modulator by Using a Fractional-N Frequency Synthesizer
Ming-Home Tasi; 蔡明宏
電子工程學研究所
2020
擁有短重鎖時間鎖頻迴路或頻寬提升技術之次取樣式鎖相迴路
Sub-Sampling PLLs with Short Re-locking-Time FLL or Bandwidth-Enhanced Technique
YuanCheng Qian; 錢源承
電子工程學研究所
探索
學位
13
碩士
指導教授
4
呂學士
2
劉深淵(shen-iuan liu)
2
李泰成(tai-cheng lee)
1
劉深淵教授
1
李泰成
1
林宗賢(tsung-hsien lin)
1
盧信嘉
1
陳中平
作者
1
bang-zao liou
1
chieh-wen lee
1
fang-ting lee
1
ken huang
1
ming-home tasi
1
shao-hung lin
1
sheng-hung lin
1
tz-cheng yang
1
wei-liang lee
1
yi-chieh huang
.
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關鍵字
9
鎖相迴路
3
鎖相迴路,頻率合成器
2
pll,cdr
2
pll,delta-sigma modulator
2
pll,frequency synthesizer
2
pll,phase-locked loop
1
pll,cdr,adaptive equalizer
1
pll,cdr,pd
1
pll,cdr,pd,fd
1
pll,cdr,pd,fd,continuous-rate
.
下一頁 >
出版年
6
2010 - 2020
7
2005 - 2009
全文授權
8
未授權
5
有償授權