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電子工程學研究所
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2019
具製程、電壓與溫度背景校正之倍頻延遲鎖定迴路
A PVT-Tolerant MDLL with a Background Coarse-Frequency Selector and a Frequency Calibrator using a Delay-Calibrated SSPD
Yu-Kai CHIU; 邱鈺凱
電子工程學研究所
探索
系所
1
電子工程學研究所
學位
1
碩士
作者
1
yu-kai chiu
1
邱鈺凱
關鍵字
1
phase-locked loop,multiplying del...
1
鎖相迴路
1
鎖相迴路,倍頻延遲鎖定迴路
1
鎖相迴路,倍頻延遲鎖定迴路,頻率合成器
出版年
1
2019
全文授權
1
未授權
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1
true