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電子工程學研究所
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2019
具有次取樣內圈相位雜訊濾波器之鎖相迴路設計
The Design and Analysis of a Phase-Locked Loop with a Sub-Sampling Inner-Loop Phase Noise Filter
Hsiu-Hsien Ting; 丁修賢
電子工程學研究所
探索
系所
1
電子工程學研究所
學位
1
碩士
指導教授
1
李泰成(tai-cheng lee)
作者
1
hsiu-hsien ting
1
丁修賢
關鍵字
1
phase-locked loop (pll)
1
phase-locked loop (pll),delay-loc...
1
phase-locked loop (pll),delay-loc...
1
phase-locked loop (pll),delay-loc...
1
鎖相迴路,延遲迴路
1
鎖相迴路,延遲迴路,次取樣相位偵測器
1
鎖相迴路,延遲迴路,次取樣相位偵測器,雜訊抑制
1
鎖相迴路,延遲迴路,次取樣相位偵測器,雜訊抑制,相位雜訊濾波器
出版年
1
2019
全文授權
1
有償授權
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1
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