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符合的文件:
出版年 | 標題 | 作者 | 系所 |
---|---|---|---|
2009 | 於0.18微米互補式金氧半製程實現之一伏特兩百億赫茲鎖相迴路設計 Design of a 1-V 20-GHz Phase-Locked Loop in 0.18-um CMOS | Yu-Hsien Fang; 方語賢 | 電子工程學研究所 |
2019 | 具有次取樣內圈相位雜訊濾波器之鎖相迴路設計 The Design and Analysis of a Phase-Locked Loop with a Sub-Sampling Inner-Loop Phase Noise Filter | Hsiu-Hsien Ting; 丁修賢 | 電子工程學研究所 |
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系所
- 2 電子工程學研究所
學位
- 2 碩士
關鍵字
- 1 phase-locked loop (pll),delay-loc...
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- 1 鎖相迴路,壓控震盪器
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