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出版年 | 標題 | 作者 | 系所 |
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2011 | 使用抑制時脈抖動技術鎖相回路之設計與實作 Design and Implementation of A Low Noise Phase-Locked Loop with Jitter Suppression Technique | Bang-Zao Liou; 劉邦灶 | 電子工程學研究所 |
2011 | 可適性接收機與次諧波注入鎖相迴路分析與設計 Analysis and Design of Adaptive Receiver and Subharmonically Injection-Locked PLL | Yi-Chieh Huang; 黃逸傑 | 電子工程學研究所 |
2010 | CMOS鎖相迴路頻率合成器之研究與應用 The Design and Application of CMOS PLL-Based Frequency Synthesizers | Yuen-Tai Chang; 張元泰 | 電子工程學研究所 |
2020 | 擁有短重鎖時間鎖頻迴路或頻寬提升技術之次取樣式鎖相迴路 Sub-Sampling PLLs with Short Re-locking-Time FLL or Bandwidth-Enhanced Technique | YuanCheng Qian; 錢源承 | 電子工程學研究所 |
2012 | 長除數頻率合成器的設計與分析 The Design and Analysis of Frequency Synthesizers with Large Multiplication Factors | Chieh-Wen Lee; 李介文 | 電子工程學研究所 |
2012 | 適用於植入式醫療通訊頻段之低功率頻率合成器及射頻發射器 Low Power Frequency Synthesizers and RF Transmitters for MICS Band | Ken Huang; 黃肯 | 電子工程學研究所 |