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出版年 | 標題 | 作者 | 系所 |
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2005 | 以0.18um CMOS積體電路技術設計支援大部份MIPS指令的低分支代價處理器 A Low Branch Penalty Processor Supporting Most MIPS Instructions in 0.18um CMOS Technology | Hung-Chi Chang; 張弘琦 | 電子工程學研究所 |
2009 | 同時調整標準單元設計的元件尺寸及臨界電壓之演算法 Simultaneous Gate Sizing and Multiple-Vt Assignment for Cell-Based Design | Shih-Pin Hung; 洪士斌 | 電子工程學研究所 |
2005 | 基板偏壓與抗時脈不精確之32位元高速加法器 Substrate Bias Optimized 32bit High Speed Adder with Post-Manufacture Tunable Clock | Qi-Wei Kuo; 郭其偉 | 電子工程學研究所 |