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出版年 | 標題 | 作者 | 系所 |
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2014 | 數百億位元多通道時脈資料回復電路之設計與分析 Design and Analysis of Tens of Gb/s Multi-Channel Clock and Data Recovery Circuits | Chien-Kai Kao; 高健凱 | 電子工程學研究所 |
2012 | 應用於高速有線通訊之數百兆位元決策回授等化器及時脈資料回復電路 Tens-Gb/s Decision-Feedback Equalizers and Clock and Data Recovery Circuits for High-Speed Wire-Line Communications | Chang-Lin Hsieh; 謝長霖 | 電子工程學研究所 |